Eine Plattform für die Wissenschaft: Bauingenieurwesen, Architektur und Urbanistik
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Estimation of Power and Delay in CMOS Circuits Using Leakage Control Transistors
Estimation of Power and Delay in CMOS Circuits Using Leakage Control Transistors
Estimation of Power and Delay in CMOS Circuits Using Leakage Control Transistors
Kumar, Aylapogu Pramod (Autor:in) / Aditya, B. L. V. S. S. (Autor:in) / Sony, G. (Autor:in) / Prasanna, Ch. (Autor:in) / Satish, A. (Autor:in)
ICLIET ; 1. ; 2018 ; Jonnada
2019
Aufsatz (Konferenz)
Englisch
DDC:
620.11
Gate leakage tolerant circuits in deep sub-100 nm CMOS technologies
| British Library Online Contents | 2006
High Temperature Silicon Carbide CMOS Integrated Circuits
| British Library Online Contents | 2011